Diferencia entre revisiones de «Artículos EC2783 Abr-Jul 2016»

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=== IIC ===
 
  
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== Protocolo IIC ==
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En esta sección se encuentran los artículos creados por los grupos del curso EC2783 Abril-Julio 2016. En los cuales se trabaja en el módulo DEMOQE128.
  
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Por favor leer sobre las normas de edición:
  
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El Protocolo Inter-Integrated Circuit (IIC), se compone de 4 partes principales, las cuales componen el envío de un mensaje, descritos a continuación:
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[[Sobre la redacción]]
  
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Señal de inicio (START Signal): Inicialmente, los buses SCL y SDA se encuentran lógicamente encendidos (en caso de estar disponibles para ser utilizados), por lo cual la señal de inicio, consiste en una bajada del flanco de SDA, mientras SCL se mantiene encendido por parte del maestro. Puede ocurrir un caso en el que se da por repetida una señal de inicio, aun sin finalizado una comunicación previa; esto indica el envío de datos bien sea con otro dispositivo esclavo, o en un modo diferente (lectura/escritura).
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[[Sobre los artículos]]
  
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Transmisión de la “llave” de esclavo: Este paso consiste en la transmisión de una dirección de 8-bit, los cuales son diferenciados por los primeros 7 bits consecutivos, que representan la “llave” que establece con cuál dispositivo esclavo se desea establecer una comunicación. Cada esclavo mantiene una clave que debe intersectar (lógico AND) con la llave enviada, y solo aquel que coincida con la clave enviada se dispondrá a “escuchar” el mensaje que será enviado a continuación. Con respecto al último bit, éste se refiere a una solicitud de tipo Lectura/Escritura. Para el bit en 1, se desea iniciar una transferencia de lectura del maestro, mientras que para el bit en 0 se desea establecer una comunicación de escritura maestro-esclavo.
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[[Sobre la corrección y discusión de artículos]]
  
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Transferencia de datos: Una vez recibida la clave por parte del esclavo correspondiente, con su respectiva dirección de transferencia de datos, se procede a ejecutar en envío de los bytes de información uno a uno, en el cual cada bit representa un clock del reloj, iniciando por el bit as representativo (MSB) y finalizando por el bit menos representativo (LSB). Por último, en el noveno flanco del clock se envía un bit de reconocimiento o de no reconocimiento; en este último caso la transmisión de data no es exitosa y se procede a abortar o a retransmitir según sea el caso.
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== Lista de Artículos ==
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Cada artículo debe estar debidamente clasificado en una o varias categorías.
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Señal de STOP: Cuando la transmisión de datos ha finalizado, ambos buses SDA Y SCL vuelven a su estado lógico inicial en 1 y tanto maestro como esclavo dan por finalizada la comunicación.
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FALTA....
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== Acelerometro  ==
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[[Categoría: EC2783 - Lab. Arquitectura del Computador - Ing. Telecom.]]
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# Artículo 1:  [[IIC_EC2783_Abril-Julio2016]]
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# Artículo 2:  [[C%C3%B3digo_Aceler%C3%B3metro_para_Codewarrior_10.6]]
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# Artículo 3:  [[Código_Acelerometro_Rutinas_de_Interrupción]]
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# Artículo 4:  [[Ejemplos_IIC_QE128QRUG]]
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# Artículo 5:  [[Configuración del Acelerómetro para Orientación]]
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# Artículo 6:  [[Registros IIC]]
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# Artículo 7:  [[Introducción IIC y sus interrupciones]]

Revisión actual del 12:27 6 jul 2016

En esta sección se encuentran los artículos creados por los grupos del curso EC2783 Abril-Julio 2016. En los cuales se trabaja en el módulo DEMOQE128.

Por favor leer sobre las normas de edición:

Sobre la redacción

Sobre los artículos

Sobre la corrección y discusión de artículos

Lista de Artículos

Cada artículo debe estar debidamente clasificado en una o varias categorías.

Formato: Estudiante (Nombre Usuario): Lista de artículos(Link Articulo1, Link Articulo2, Etc)

Ejemplo:


  1. Artículo 1: IIC_EC2783_Abril-Julio2016
  2. Artículo 2: Código_Acelerómetro_para_Codewarrior_10.6
  3. Artículo 3: Código_Acelerometro_Rutinas_de_Interrupción
  4. Artículo 4: Ejemplos_IIC_QE128QRUG
  5. Artículo 5: Configuración del Acelerómetro para Orientación
  6. Artículo 6: Registros IIC
  7. Artículo 7: Introducción IIC y sus interrupciones
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